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专利信息

Serdes接口电路【异议或纠错】

档案编号： CQ-177-6007-6662
档案文号：
专利权人： 申请人 
发布时间： 发布时间 
档案分类： 专利权 
分 类 号： 第H03K19/0185;G06F1/10;G06F5/06类
授权状态： 已授权
档案内容： 本发明提供了一种Serdes接口电路,包括若干接收网桥单元,接收网桥单元包括,对齐调整模块,用于接收Serdes接口各个通道中解码后的解码数据,将解码数据调整到对齐状态,并输出对齐状态数据；补偿频差删除模块,用于对对齐状态数据中的特殊字符skip pattern进行删除操作,并将补偿频差删除数据写入FIFO缓存；数据调整模块,用于对FIFO的读出数据进行数据调整,并输出调整数据；补偿频差补位模块,用于对调整数据进行插入操作,并输出对齐调整数据；状态发生模块,用于控制多通道对齐,并判断是否完成对齐。本发明的接口电路消除了误码导致的各个通道内特殊字符Apattern间隔改变的影响,保证了数据对齐的顺利完成,提高了serdes的传输性能以及系统工作的稳定性。
附件下载：  (原始资料备查)

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