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一种大规模信道仿真的FPGA实现方法及实现架构【异议或纠错】

档案编号: CQ-435-3537-7704
档案文号:
专利权人: 申请人 
发布时间: 发布时间 
档案分类: 专利权 
分 类 号: 第H04B17/391;H04B17/345类
授权状态: 已授权
档案内容: 本发明公开了一种大规模信道仿真的FPGA实现方法及实现架构,包括16个ATCA-3671加速器,每个ATCA-3671有4个Virtex-7FPGA,共64个FPGA,分成32组,每组包含2个FPGA;其中1个FPGA连接两路SDR,该FPGA设置64路接收仿真信道,并将64路的接收仿真信道合成一个信道,加入高斯白噪声影响;所述接收仿真信道包括依次连接的多普勒频移模块、传播时延模块、多径时延模块、大尺度衰落模块;另1个FPGA用于通过数据搬移,分担资源消耗。本发明使用结构化的方法将工作负载分布到多个处理节点;通过本发明能够解决计算量和带宽带来的复杂性问题,实现大规模信道仿真。
附件下载:  (原始资料备查)

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