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一种调整FPGA总线延时的方法及装置【异议或纠错】

档案编号: CQ-492-4348-6406
档案文号:
专利权人: 申请人 
发布时间: 发布时间 
档案分类: 专利权 
分 类 号: 第G06F13/40;G01R31/02类
授权状态: 已授权
档案内容: 本发明公开了一种调整FPGA总线延时的方法,包括,主FPGA通过总线发送信号给从FPGA;从FPGA检测到任何一条信号线上的信号时,记录从FPGA检测到的该组总线所有信号线上的信号;判断是否存在没有检测到状态反转的信号线;如果存在没有检测到状态反转的信号线,在主FPGA和从FPGA中选择一个总线所有管脚延时都未达到系统设定最大值的FPGA,将所选择的FPGA中所有接收到的信号正确的信号线对应的管脚延时一个延时单位,否则记录主FPGA和从FPGA所有管脚的延时单位数据。本发明还公开了一种与所述方法相适应的FPGA总线延时调整装置,本发明的技术方案实现了自动调整总线各管脚延时单元数据,提高了FPGA总线延时调整效率。
附件下载:  (原始资料备查)

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