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专利信息

一种基于FPGA中SERDES的4倍过采样的数据恢复方法【异议或纠错】

档案编号： CQ-261-1987-8926
档案文号：
专利权人： 申请人 
发布时间： 发布时间 
档案分类： 专利权 
分 类 号： 第H03L7/091;H03K5/1534类
授权状态： 已授权
档案内容： 本发明提供一种基于FPGA中SERDES的4倍过采样的数据恢复方法,方法包括：4倍过采样电路单元由SERDES RX端实现,将其配置CDR锁定到参考时钟模式,然后SERDES RX端用4倍于输入数据的速率采样输入的串行数据,把采样的数据转成并行数据,之后输出；输入处理单元对4倍过采样电路单元输出的并行数据进行处理,得到边沿数据以及对应位置数据,之后输出；采样位置判决单元接收输入处理单元输出的边沿数据以及对应位置数据,根据边沿数据选择采样点,并输出被选择的采样点数据；输出处理单元接收有效数据,对有效数据进行缓存,根据设定需求,输出有效数据,降低系统成本和功耗。
附件下载：  (原始资料备查)

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