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专利信息

一种基于RISCV串行FLASH系统架构的高效CPU指令读取法【异议或纠错】

档案编号： CQ-719-5980-1163
档案文号：
专利权人： 申请人 
发布时间： 发布时间 
档案分类： 专利权 
分 类 号： 第G06F9/30类
授权状态： 已授权
档案内容： 本发明公开了CPU指令读取技术,尤其是涉及一种基于RISC_V串行FLASH系统架构的高效CPU指令读取法。该一种基于RISC_V串行FLASH系统架构的高效CPU指令读取法,硬件架构内cache line共16条；每次CPU读取某条地址的指令时,硬件逻辑会在16条Cache line中做地址匹配,当指令地址已经存在于当前的指令缓存中,则直接从SRAM中读取指令；当CPU读取的指令地址不存在于当前的指令缓存中时,逻辑才会发起对FLASH访问命令,并一次性读取一定条数的地址连续的指令并存储到SRAM中,用于替换旧的缓存指令。其有益效果是：降低了企业生产成本,降低了企业的经济损失,给企业正常运营带来极大的便利。
附件下载：  (原始资料备查)

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