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专利信息

SoC芯片顶层模块集成设计方法及系统【异议或纠错】

档案编号： CQ-081-5875-9533
档案文号：
专利权人： 申请人 
发布时间： 发布时间 
档案分类： 专利权 
分 类 号： 第G06F30/39;G06F8/30;G06F8/41;G06F115/02类
授权状态： 已授权
档案内容： 本公开涉及一种SoC芯片顶层模块集成设计方法及系统,其中方法包括：获取目标SoC芯片的设计文件,所述设计文件是基于硬件描述语言预先编写的；通过指定Python程序调用Pyverilog的代码解析器和数据流分析器,以对所述设计文件进行代码解析和数据流分析处理得到各个底层模块的设计信息；接收用户针对所述设计信息中的第一部分信息的输入信息,响应于用户针对所述设计信息中的第二部分信息的确认操作,基于所述设计信息和所述输入信息生成第一配置文件；通过所述指定Python程序读取所述第一配置文件,并调用所述Pyverilog的代码生成器以使所述代码生成器基于所述第一配置文件生成顶层设计文件。
附件下载：  (原始资料备查)

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